Микропроцессорные устройства

ADPS2 ADPS1 ADPS0 Коэффициент деления 
0 
0 
0 
2 
0 
0 
1 
2 
0 
1 
0 
4 
0 
1 
1 
8 
1 
0 
0 
16 
1 
0 
1 
32 
1 
1 
0 
64 
1 
1 
1 
128 
ADC (ADCL и ADCH) – регистры данных ADC (рис. 7.25, 7.26). 
По завершении преобразования результат помещается в этих двух реги-
страх. При использовании дифференциального режима преобразования резуль-
тат представляется в коде двоичного дополнения. 
Рис. 7.25 – Регистры ADCL и ADCH для ADLAR = 0 
Рис. 7.26 – Регистры ADCL и ADCH для ADLAR = 1 

---

119 
Формат представления результата (левостороннее выравнивание или пра-
востороннее выравнивание) зависит от состояния бита ADLAR в регистре 
ADMUX. Левосторонний формат представления результата удобно использо-
вать, если достаточно 8 разрядов. В этом случае 8-разрядный результат хранит-
ся в регистре ADCH и, следовательно, чтение регистра ADCL можно не выпол-
нять. При правостороннем формате необходимо сначала считать ADCL, а затем 
ADCH. 
SFIOR – регистр специальных функций ввода-вывода (рис. 7.27). 
Рис. 7.27 – Регистр SFIOR 

Bit 7:5 – ADTS2:0: биты выбора источника автоматического запуска 
ADC. Если ADATE в регистре ADCSRA записан в логическую 1, зна-
чения бит ADTS определяют, какой будет использоваться источник 
для запуска преобразования. Если ADATE в регистре ADCSRA запи-
сан в логический 0, значения бит ADTS никакого значения не имеют 
(табл. 7.9). Преобразование будет запускаться по положительному 
фронту (нарастание сигнала) выбранного сигнала. 
Таблица 7.9 1– Источник запуска преобразования ADC 
ADTS2 ADTS1 ADTS0